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@ -547,8 +547,8 @@ |
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#define sdrcfga (SDR_DCR_BASE+0x0) /* ADDR */ |
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#define sdrcfgd (SDR_DCR_BASE+0x1) /* Data */ |
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#define mtsdr(reg, data) mtdcr(sdrcfga,reg);mtdcr(sdrcfgd,data) |
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#define mfsdr(reg, data) mtdcr(sdrcfga,reg);data = mfdcr(sdrcfgd) |
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#define mtsdr(reg, data) do { mtdcr(sdrcfga,reg);mtdcr(sdrcfgd,data); } while (0) |
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#define mfsdr(reg, data) do { mtdcr(sdrcfga,reg);data = mfdcr(sdrcfgd); } while (0) |
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#define sdrnand0 0x4000 |
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#define sdrultra0 0x4040 |
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@ -593,8 +593,8 @@ |
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/*
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* Macro for accessing the indirect CPR register |
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*/ |
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#define mtcpr(reg, data) mtdcr(cprcfga,reg);mtdcr(cprcfgd,data) |
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#define mfcpr(reg, data) mtdcr(cprcfga,reg);data = mfdcr(cprcfgd) |
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#define mtcpr(reg, data) do { mtdcr(cprcfga,reg);mtdcr(cprcfgd,data); } while (0) |
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#define mfcpr(reg, data) do { mtdcr(cprcfga,reg);data = mfdcr(cprcfgd); } while (0) |
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#define CPR_CLKUPD_ENPLLCH_EN 0x40000000 /* Enable CPR PLL Changes */ |
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#define CPR_CLKUPD_ENDVCH_EN 0x20000000 /* Enable CPR Sys. Div. Changes */ |
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